可調式分數延遲數位濾波器之設計與實現 = Design and Impl...
國立高雄大學電機工程學系碩士班

 

  • 可調式分數延遲數位濾波器之設計與實現 = Design and Implementation of Variable Fractional-Delay Digital Filters
  • 紀錄類型: 書目-語言資料,印刷品 : 單行本
    並列題名: Design and Implementation of Variable Fractional-Delay Digital Filters
    作者: 王振洋,
    其他團體作者: 國立高雄大學
    出版地: [高雄市]
    出版者: 撰者;
    出版年: 民99[2010]
    面頁冊數: 147面圖,表 : 30公分;
    標題: 有限脈衝響應(FIR)濾波器
    標題: Farrow structure
    電子資源: http://handle.ncl.edu.tw/11296/ndltd/51090323946040234051
    摘要註: 論文中針對可調式分數延遲數位濾波器進行了三種型式(有限脈衝響應、全通、無限脈衝響應)的設計,使用權重式最小平方差概念設計濾波器的誤差函數,並在實現系統的過程中引入菲蘿結構。硬體設計中,使用移位法處理含小數點的數字運算,避免使用浮點元件必然會帶來的高電路複雜度。硬體電路以Verilog硬體描述語言設計,並於ModelSim(Mentor Graphics公司發行之硬體描述語言程式設計工具)中進行驗證,硬體波型圖最終將與理論設計所得之運算結果相比較。各硬體設計經過Design Vision(Synopsys公司發行之數位邏輯合成工具)合成後的結構圖放置在各章結尾處,而它們的面積、時脈、功率報告則置於附錄中。 In the thesis, three types (finite impulse response, allpass, and infinite impulse response) of design on variable fractional-delay filters are proposed, and the technique of weighted-least-square method will be applied. For the implementation of the designed system, Farrow structure will be incorporated in the design of the stated variable fractional-delay filters. In the hardware design, shifting method takes the place of floating-point unit in order to decrease the complexity of circuits. The circuits are designed in Verilog harware description language with ModelSim. After making sure the fuctions are correct, we compare waveforms with the outcomes of theoretical computation. The schematics after synthesizing from Design Vision are showed in the end of each chapter. Area reports, timing reports, and power reports will be found in the appendix.
館藏
  • 2 筆 • 頁數 1 •
 
310002027939 博碩士論文區(二樓) 不外借資料 學位論文 TH 008M/0019 542201 1053 2010 一般使用(Normal) 在架 0
310002027947 博碩士論文區(二樓) 不外借資料 學位論文 TH 008M/0019 542201 1053 2010 c.2 一般使用(Normal) 在架 0
  • 2 筆 • 頁數 1 •
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