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以 FPGA 雙核心晶片加速經驗模態分解 = FPGA-based Ch...

國立高雄大學資訊工程學系碩士班

以 FPGA 雙核心晶片加速經驗模態分解 = FPGA-based Chip with Dual Core for Speeding up Calculation of EMD : 以語音辨識為例; An Example for Speech Recognition

Record Type:	Language materials, printed : monographic
Paralel Title:	FPGA-based Chip with Dual Core for Speeding up Calculation of EMD
Title Information:	以語音辨識為例
Author:	曾文信,
Secondary Intellectual Responsibility:	國立高雄大學
Place of Publication:	高雄市
Published:	國立高雄大學;
Year of Publication:	2016[民105]
Description:	vi,39葉圖，表 : 30公分;
Subject:	隱藏式馬可夫模型
Subject:	Hidden Markov Model
Online resource:	https://hdl.handle.net/11296/x883my
Notes:	110年12月1日公開
Notes:	參考書目：葉37-39

以 FPGA 雙核心晶片加速經驗模態分解 = FPGA-based Chip with Dual Core for Speeding up Calculation of EMD : 以語音辨識為例; An Example for Speech Recognition
曾, 文信

以 FPGA 雙核心晶片加速經驗模態分解 = FPGA-based Chip with Dual Core for Speeding up Calculation of EMD : 以語音辨識為例 / 曾文信撰 - 高雄市 : 國立高雄大學, 2016[民105]. - vi,39葉 ; 圖，表 ; 30公分.
110年12月1日公開參考書目：葉37-39.
隱藏式馬可夫模型Hidden Markov Model

以 FPGA 雙核心晶片加速經驗模態分解 = FPGA-based Chip with Dual Core for Speeding up Calculation of EMD : 以語音辨識為例; An Example for Speech Recognition
LDR:01215pam0a2200265 450 001 484496
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010 0 $b 平裝
010 0 $b 精裝
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300 $a 參考書目：葉37-39
314 $a 指導教授：潘欣泰博士
328 $a 碩士論文--國立高雄大學資訊工程學系碩士班
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610 # 0 $a 隱藏式馬可夫模型 $a 經驗模態分解 $a 語音辨識 $a 多核心系統
610 # 1 $a Hidden Markov Model $a Empirical Mode Decomposition $a Speech Recognition $a Multi-Core System $a FPGA
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