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可重組類神經網路晶片設計並實現於FPGA = Reconfigurabl...

國立高雄大學資訊工程學系碩士班

可重組類神經網路晶片設計並實現於FPGA = Reconfigurable Artificial Neural-Network Chip Design and Implementation on FPGA

Record Type:	Language materials, printed : monographic
Paralel Title:	Reconfigurable Artificial Neural-Network Chip Design and Implementation on FPGA
Author:	蘇育德,
Secondary Intellectual Responsibility:	國立高雄大學
Place of Publication:	高雄市
Published:	國立高雄大學;
Year of Publication:	2020[民109]
Description:	[11]，44葉圖，表 : 30公分;
Subject:	可重組式類神經網路
Subject:	Reconfigurable Artificial Neural-Network
Online resource:	https://handle.ncl.edu.tw/11296/2d62tk
Notes:	109年11月18日公開
Notes:	參考書目：葉33-34

可重組類神經網路晶片設計並實現於FPGA = Reconfigurable Artificial Neural-Network Chip Design and Implementation on FPGA
蘇, 育德

可重組類神經網路晶片設計並實現於FPGA = Reconfigurable Artificial Neural-Network Chip Design and Implementation on FPGA / 蘇育德撰 - 高雄市 : 國立高雄大學, 2020[民109]. - [11]，44葉 ; 圖，表 ; 30公分.
109年11月18日公開參考書目：葉33-34.
可重組式類神經網路Reconfigurable Artificial Neural-Network

可重組類神經網路晶片設計並實現於FPGA = Reconfigurable Artificial Neural-Network Chip Design and Implementation on FPGA
LDR:01179pam0a2200265 450 001 573240
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010 0 $b 精裝
010 0 $b 平裝
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101 0 $a chi $d chi $d eng
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200 1 $a 可重組類神經網路晶片設計並實現於FPGA $d Reconfigurable Artificial Neural-Network Chip Design and Implementation on FPGA $z eng $f 蘇育德撰
210 $a 高雄市 $c 國立高雄大學 $d 2020[民109]
215 0 $a [11]，44葉 $c 圖，表 $d 30公分
300 $a 109年11月18日公開
300 $a 參考書目：葉33-34
314 $a 指導教授：潘欣泰博士
328 $a 碩士論文--國立高雄大學資訊工程學系碩士班
510 1 $a Reconfigurable Artificial Neural-Network Chip Design and Implementation on FPGA $z eng
610 # 0 $a 可重組式類神經網路 $a 場域可程式化邏輯閘陣列 $a Verilog $a 倒傳遞
610 # 1 $a Reconfigurable Artificial Neural-Network $a Field Programmable Gate Array $a Verilog $a Backward Propagation
681 $a 008M/0019 $b 464103 4402.1 $v 2007年版
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856 7 # $u https://handle.ncl.edu.tw/11296/2d62tk $z 電子資源 $2 http